No.3ベストアンサー
- 回答日時:
入力波形が綺麗だから理想スイッチングとは限りません
出力つまりドレインーソースが動作してないと(断線とか劣化とか)綺麗になる事はあります
ドレインからゲートへの帰還がある為に通常はゲート波形の乱れが起こります
負荷が軽いと帰還量も小さいので乱れも小さいです 特に立ち上がり立下り時
じゃあ 余裕のある設計すれば綺麗かと思いますが
余裕あるFETは入力容量も大きくドライブ回路も余裕が必要になり高価になります
無駄の少ない素子選びが大事となります
スイッチングロスは主に出力側つまりドレインーソースの特性で決まります。
この回答へのお礼
お礼日時:2011/05/10 17:45
ゲートソース間の波形は綺麗だったのですが、波形が乱れていた理由がつかめとても参考になりました。
参考にさせていただきます。このたびはどうもありがとうございました。
No.2
- 回答日時:
ゲート電圧波形が理想的だとしてもスイッチングロスがゼロになるわけでは有りません。
ドレイン電流がゼロの時にスイッチすればスイッチングロスを極小に出来ます。
この辺では色々特許が出ています。
http://www.patentjp.com/07/W/W101110/DA10001.html
http://www.patentjp.com/06/W/W100024/DA10001.html
この回答へのお礼
お礼日時:2011/05/06 17:37
ありがとうございます。
なまった方形波とかだとロスが生じると訊いたことがあるのでどうかな、と思ったんですが特許のページも自分には知らないことだったので参考になりました。
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